SOC设计实验箱融合FPGA数字系统设计和SOC开发应用的企业级项目案例，为学生提供创新创业开发平台，为老师提供横向课题开发环境。
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SOC设计实验箱采用企业真实工程型项目开发环境，硬件逻辑资源丰富，可满足各类FPGA应用场景的环境搭建。同时搭配4核ARM内核，可满足SOC系统级设计需求，巩固Verilog HDL硬件描述语言语法知识，同时熟悉Modelsim软件、Vivado软件等FPGA工具的开发流程，充分掌握逻辑设计、功能仿真、布局布线、时序仿真、硬件验证等相关测试验证方法， 拆分自真实项目的实验案例。
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