本发明公开了一种基于 flash 编程干扰错误感知的 LDPC 译码优化方法,随着 NAND 闪存存储密度的提升,每个单元存储较多的比特信息,单元之间的耦合干扰较强烈,造成严重的编程干扰错误,使得传统的 BCH 码不足以保证数据的可靠性,LDPC 码具有优于 BCH 码的纠错性能而被应用于 NAND 闪存存储系统中。使用被优化的 LDPC译码算法具有重要意义。现已观察,编程干扰错误具有数值相关性特征,当进行 LDPC